- •В.В. Болгов, в.И. Енин, а.В. Смольянинов
- •Схемотехника
- •В.В. Болгов, в.И. Енин, а.В. Смольянинов Схемотехника
- •Схемотехника
- •Введение
- •После изучения дисциплины необходимо знать:
- •После изучения дисциплины необходимо уметь:
- •В.1. Роль и место курса “Схемотехника” в учебном процессе
- •В.2. Основные направления развития цифровых устройств
- •В.3. Самостоятельная работа студентов и контроль знаний
- •1 . Основы теории логических функций.
- •1.1. Логические функции
- •1.2. Основные законы и тождества алгебры логики
- •1.3. Формы представления логических функций
- •Совершенная дизъюнктивная нормальная форма
- •Совершенная конъюнктивная нормальная форма
- •Получение логических выражений скнф и сднф
- •1.4. Минимизация логических функций
- •Метод Квайна
- •Метод карт Вейча
- •1.5. Построение и анализ работы логических схем
- •1.6. Построение логических схем с несколькими выходами
- •1.7. Вопросы и задания для самоконтроля
- •2. Интегральные микросхемы
- •2.1. Технологии цифровых интегральных схем
- •2.2. Параметры интегральных микросхем
- •2.3. Логические элементы транзисторно-транзисторной логики
- •2.3.1. Входные каскады ттл микросхем
- •2.3.2. Типы выходных каскадов ттл цифровых элементов
- •Логический выход
- •Элементы с тремя состояниями
- •Выходные каскады с открытым эмиттером
- •Выход с открытым коллектором
- •Основные характеристики микросхем ттл серий
- •2.4. Логические элементы эмиттерно-связанной логики
- •2.5. Логические элементы на моп‑транзисторах
- •2.6. Кмоп микросхемы
- •2.6.1. Режим неиспользуемых входов
- •2.6.2. Преобразователи уровня
- •2.7. Простейшие интегральные микросхемы
- •2.8. Шинные формирователи и приемопередатчики
- •2.9. Вопросы и задания для самоконтроля
- •3. Устройства комбинационного типа
- •Двоичные шифраторы и дешифраторы
- •3.1.1. Разработка схемы шифратора и его работа
- •3.1.2. Приоритетный шифратор
- •3.1.3. Разработка схемы дешифратора и его работа
- •3.1.4. Преобразователи кодов
- •3.2. Мультиплексоры и демультиплексоры
- •3.2.1. Мультиплексоры
- •3.2.2. Демультиплексоры
- •3.2.3. Получение мультиплексоров и демультиплексоров на большое количество входов (выходов)
- •3.2.4. Универсальные логические модули
- •3.2.5. Совместная работа мультиплексора и демультиплексора
- •3.3. Сумматоры, алу и матричные умножители
- •3.3.1. Одноразрядный сумматор
- •3.3.2. Сумматор последовательного действия
- •3.3.3. Сумматор параллельного действия с последовательным переносом
- •3.3.4. Сумматор параллельного действия с параллельным переносом
- •3.3.5 Арифметико-логические устройства
- •3.3.6. Матричные умножители
- •3.4. Компараторы
- •3.5 Схемы контроля
- •3.6. Вопросы и задания для самоконтроля
- •4. Узлы последовательностного типа
- •4.1. Триггеры
- •4.1.1. Асинхронные триггеры
- •4.1.2. Асинхронный d-триггер
- •4.1.3. Синхронные триггеры
- •Синхронный rs-триггер
- •Синхронный d-триггер
- •Триггеров
- •4.1.4. Триггеры с двухступенчатым запоминанием информации
- •4.1.6. Счетный триггер
- •4.1.7. Динамические триггеры
- •4.1.8. Установка начального значения триггера
- •4.1.9. Триггеры Шмидта
- •4.2. Регистры
- •4.2.1. Параллельный регистр
- •4.2.2. Последовательные (сдвигающие) регистры
- •4.2.3. Взаимное преобразование числа из последовательного кода в параллельный
- •4.3. Счётчики
- •4.3.1. Суммирующие счетчики
- •4.3.2. Вычитающие счетчики
- •4.3.3. Реверсивные двоичные счетчики
- •4.3.4. Кольцевые счетчики
- •4.3.5. Условное обозначение счетчиков
- •4.3.6. Быстродействие счетчиков
- •4.3.7. Программирование счетчиков
- •4.4. Вопросы и задания для самоконтроля
- •5. Аналого-цифровые и цифро-аналоговые преобразователи
- •5.1. Аналого-цифровые преобразователи
- •5.1.1. Принцип аналого-цифрового преобразования
- •5.1.2. Ацп с промежуточным преобразованием во временной интервал
- •5.1.3. Аналого-цифровой преобразователь с обратной связью
- •5.1.4 Аналого-цифровой преобразователь следящего типа
- •5.1.5. Параллельный ацп
- •5.1.6. Интегрирующие ацп
- •5.1.7. Ацп последовательных приближений
- •5.2. Цифро-аналоговые преобразователи
- •5.3. Преобразователи интервалов времени
- •5.4. Вопросы для самоконтроля
- •6. Устройства хранения информации
- •6.1. Основные характеристики запоминающих устройств
- •6.2. Оперативные запоминающие устройства
- •6.2.1. Статические озу
- •6.2.2. Динамические озу Принцип действия динамических озу
- •Схемные особенности динамических озу
- •6.3. Постоянные запоминающие устройства
- •Масочные пзу
- •Программируемые пзу
- •6.4. Перепрограммируемые запоминающие устройства
- •Флэш-память
- •6.5. Вопросы для самоконтроля
- •7. Селекторы импульсных сигналов
- •7.1. Амплитудные селекторы
- •7.1.1. Селектор максимального уровня
- •7.1.2. Селектор минимального уровня
- •7.2. Временные селекторы
- •7.3 Селекторы импульсов по длительности
- •7.3.1. Селекторы максимальной длительности
- •7.3.2. Селекторы минимальной длительности
- •7.4 Элементы задержки и формирователи импульсов
- •7.5. Вопросы для самоконтроля
- •8. Средства отображения информации
- •8.1. Газоразрядные цифровые индикаторы
- •8.2. Знакосинтезирующие индикаторы
- •8.3. Вакуумные люминесцентные индикаторы
- •8.4. Вакуумные накаливаемые индикаторы
- •8.5. Полупроводниковые семисегментные индикаторы
- •8.6. Жидкокристаллические индикаторы (жки)
- •8.7. Матричные индикаторы
- •8.8. Подключение индикаторов к эвм
- •8.9. Вопросы и задания для самоконтроля
- •9. Автоматы
- •9.1. Автомат в системе управления
- •9.2. Структурный автомат
- •9.3. Аппаратная реализация автоматов
- •9.4. Вопросы и задания для самоконтроля
- •Заключение
- •Б иблиографический список
- •ПриложенИя
- •Приложение 1. Обозначения цифровых микросхем
- •Приложение 2. Условные графические обозначения элементов цифровой техники
- •Оглавление
5.1.5. Параллельный ацп
Параллельные АЦП состоят из следующих основных узлов: делитель опорных напряжений, выполненный на резисторах, набор компараторов напряжения, регистры хранения, дешифратор и выходные каскады (рис.5.5).
Обычно компаратор и регистр хранения делают стробируемыми. АЦП работает следующим образом: входное напряжение одновременно поступает на неинвертирующие входы всех компараторов, которые производят в момент поступления стробирующего импульса сравнение этого сигнала с напряжениями, поступающими на инвертирующие входы с резистивного делителя напряжения. Результат сравнения поступает в регистр хранения для запоминания по стробу и затем в дешифратор. Дешифратор преобразует код, поступающий с компараторов в двоичный код. Код с выхода дешифратора поступает на выходные каскады для преобразования в стандартные уровни с игналов.
Рис. 5.5. Параллельный АЦП
5.1.6. Интегрирующие ацп
И нтегрирующие АЦП по принципу работы в значительной мере напоминают АЦП с промежуточным преобразованием входного напряжения во временной интервал.
Рис. 5.6 АЦП двойного интегрирования
Большинство интегрирующих АЦП работает в два такта интегрирования. Поэтому их называют АЦП двухтактного интегрирования
Принцип работы АЦП двойного интегрирования представлен на рис.5.6.
Р ис. 5.7. Диаграмма работы АЦП двойного преобразования
На первом такте работы (рис.5.7) устройство управления, замыкая ключ К1, подключает источник входного сигнала к входу интегратора. Одновременно определяется полярность входного напряжения и включается счетчик, отмеряющий установленный интервал времени ТИНТ интегрирования входного сигнала. После истечения заданного времени интегрирования входного сигнала конденсатор окажется заряженным до некоторого уровня пропорционального величине входного сигнала.
Затем устройство управления отключает источник сигнала и, замыкая в зависимости от полярности входного напряжения ключи К2 или К3, подключает источник опорного напряжения ко входу интегратора так, что интегратор начинает разряжаться. Происходит интегрирование опорного сигнала противоположной полярности от входного сигнала. Одновременно устройство управления включает счетчик. Момент полного разряда интегратора (достижения выходным сигналом интегратора уровня нуля) фиксируется компаратором, подключенным к выходу интегратора. Выходной дискретный сигнал компаратора поступает как один из управляющих сигналов счетчика. Счет продолжается до полного разряда интегратора. Содержимое счетчика в этот момент будет пропорционально входному сигналу: , где ТТАКТ – тактовая частота ГТИ.
5.1.7. Ацп последовательных приближений
А
Рис.
5.8. АЦП последовательных приближений
На рис.5.9 представлена временная диаграмма работы 4-разрядного АЦП. Первый такт устанавливает старший третий разряд соответствующий числу 8. Установившийся на выходе ЦАП уровень 8 больше входного сигнала UВХ=4.3. Поэтому на выходе компаратора устанавливается сигнал 0 (меньше). Выходной сигнал компаратора 0 заставляет в следующем такте при установке второго разряда (что соответствует числу 4) снимать третий разряд. В результате выходной сигнал ЦАП станет равным 4<4.3 и на выходе компаратора появится 1 (больше). Поэтому в следующем такте при установке первого разряда второй разряд не снимается и выходной сигнал станет равным 6>4.3. Поэтому в следующем такте первый разряд снимается, а нулевой – устанавливается.